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一种基于自偏置技术的低抖动锁相环

作者:盛炜; 张国华; 杨霄垒; 张沁枫自偏置锁相环压控振荡器低抖动

摘要:设计了一种环路带宽与输入频率的比值固定的自偏置锁相环。对VCO延迟单元进行改进,降低了抖动。采用SMIC 65nm CMOS工艺,在1.2V的工作电压下对锁相环进行仿真,输出频率范围为0.5~3.125 GHz。仿真结果表明,在输出频率1.875 GHz处的峰峰值抖动为8.7ps,电路的核心功耗为45mW,相位噪声为-79.7dBc/Hz。

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微电子学

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