作者：王永维fpga数字秒表模块化设计vhdl
摘要：文中介绍了一种基于FPGA的数字秒表设计方法。采用VHDL硬件描述语言,运用ModelSim等EDA仿真工具。该设计具有电路少、集成度高、可靠性强等优点。最后经实验验证,该数字秒表计时准确,输入信号能准确控制秒表运行。系统所采用的自上而下的模块化设计方法,对于其他复杂的系统设计也有很强的借鉴意义。
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《电子元器件应用》是一本有较高学术价值的月刊，自创刊以来，以电子元器件应用为主题，以前倨后恭器件、新设计、新技术为主线，以技术性、资料性、实用性为特色。选题新奇而不失报道广度，服务大众而不失理论高度，颇受业界和广大读者的关注和好评。
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