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针对高速接口的源同步时钟实现方案的研究

高速接口源同步时钟定时预算约束高速数据总线

摘要:引言 在过去的十年里,高速数据总线一直在不断地发展.它们不仅变得更快,而且还在改变系统对数据的定时方式.为了增加数据吞吐量,新兴的同步数字总线可利用一系列定时电路在每个周期中进行多次数据传送.

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电子设计应用

《电子设计应用》(CN:11-4916/TN)是一本有较高学术价值的月刊,自创刊以来,选题新奇而不失报道广度,服务大众而不失理论高度。颇受业界和广大读者的关注和好评。

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